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EDK-LA-AIXS-I龙架构结合异构加速综合实验系统

EDK-LA-AIXS-I龙架构结合异构加速综合实验系统

产品型号 : EDK-LA-AIXS-I

2025-02-20 浏览次数: 23
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实验系统的主核心为龙芯的LoongArch架构处理器,并协同ARM架构的高性能A53进行协同处理,同时以RISC-V架构自主可控的CPU为异构系统中的预处理单元。形成大量GPUFPGA阵列成计算阵列。利用该系统可实现基于异构基座的多模态SoC模块,具有可重构、低功耗、高性能等特点。该设备将装配与学校知识产权共享的智能教学实验管理系统,提供学生个性化智能题库、学生线上线下融合、不脱离动手操作的智慧化试验系统,教授后台监管与人才培养方案微调系统,融入Deepseek或千问等国产开源大模型的智慧体助教系统等功能。


性能:

l  计算阵列:以Cortex-A7异构服集群的计算颗粒有>=50Cortex-A7架构国产PSOC系列FPGA组成,计算颗粒负责分布式类脑计算的神经元模拟。该系列FPGA需支持>=20k的逻辑单元提供,为后期支撑开发定制高速利的可加密定制化神经元。

l  预处理单元:50个节点采用4VexRiscv处理器架构SOC系列FPGA

l  开发环境:支持vivadovitisscaledEDAIAR

l  存储:主内存需32Gd) 主核心提供EEPROM 64KbNor Flash 128MbQSPI Flash 128Mb。主硬盘进行整体数据的存储,存储格式采用M.2的硬盘,并且 1TB

 

应用场景:

l  智能化的物联生态计算

l  智能传感

l  多模态大模型部署


 


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